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MPC2104/5/6/7系列芯片解密研究

时间:2011-03-08 09:13:39

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该MPC2104/5/6/7旨在提供与PowerPC参考平台(准备)和PowerPC通用硬件参考平台(菲律宾人权委员会)规格的一致性可突发,高性能的PowerPC微处理器家族的60倍的二级缓存。这些产品利用同步或异步数据RAM。在MPC2104,MPC2105,MPC2106和模块利用同步BurstRAMs.The作为32K × 72,× 72配置的64K和128K × 72在182位(91 × 2)针DIMM格式。使用了摩托罗拉的MPC2104的5伏为32K x 18四;的MPC2105使用了5伏的64K × 18四;的MPC2106使用了5伏的64K × 18八。为标记位,5伏标签RAM缓存配置为标记的16K × 12场的有效的和肮脏的状态位加的16K × 2是used.Bursts可与ADS的信号启动。随后爆发产生的内部地址是由CNTEN signal.Write周期BurstRAM在内部自定时,并由时钟(CLKx)输入的上升沿启动。八是字节写使能写控制提供。在MPC2107利用asynch RAM的ronous数据。该模块被配置为在同为32K x 182针DIMM格式64。同样,5伏高速缓存标记RAM的配置为标记的16K × 12场的有效的和肮脏的状态位加上使用的16K × 2。能力是在突发爆裂提供的地址,两个地址latch.Presence绕过检测引脚被自动缓存的控制配置。串行EEPROM是可选的,以提供更深入的缓存模块的描述。该EEPROM将在模块的引出线family.The模块系列提供未来版本将支持一个明确的路径5 V和3.3 V组件,以降低电压和功耗。两个电源必须是这些缓存模块connected.All是插头,彼此接脚相容。
·PowerPC的风格突发计数器(MPC2104/5/6)片上
·流量,通过数据I / O(MPC2104/5/6)
·将和引脚整个模块的兼容性
·为减少加载多个时钟引脚
·所有缓存数据和标签的I / O是的LVTTL(3.3 V)的兼容(MPC2104/5/6)
·三态输出
·字节写功能
·快速模块时钟速率:最高可达66兆赫
·快速SRAM的访问时间:10 ns的匹配标签RAM
9数据RAM(MPC2104/5/6)纳秒
15数据RAM(MPC2107)纳秒
为每个快速静态RAM ·去耦电容
·高品质的多层的FR4具有独立的电源和地平面工作计划和预算
· 182针卡EDGE模块
·Burndy连接器型号:ELF182JSC - 3Z50
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